放大器设计
发布日期:2017-06-30 浏览次数:1016
运算放大器是模数转换电路中的一个最通用、最重要的的单元。全差分运放是指输入和输出都是差分信号的运放, 与普通的单端输出运放相比有以下几个优点: 输出的电压摆幅较大;较好的抑制共模噪声;更低的噪声;抑制谐波失真的偶数阶项比较好等。因此通常高性能的运放多采用全差分形式。近年来,全差分运放更高的单位增益带宽频率及更大的输出摆幅使得它在高速和低压电路中的应用更加广泛。随着日益增加的数据转换率, 高速的模数转换器需求越来越广泛, 而高速模数转换器需要高增益和高单位增益带宽运放来满足系统精度和快速建立的需要。速度和精度是模拟电路两个最重要的性能指标,然而,这两者的要求是互相制约、互为矛盾的。所以同时满足这两方面的要求是困难的。折叠共源共栅技术可以较成功地解决这一难题, 这种结构的运放具有较高的开环增益及很高的单位增益带宽。全差分运放的缺点是它外部反馈环的共模环路增益很小, 输出共模电平不能精确确定,因此,一般情况下需加共模反馈电路。
运放结构的选择
手机信号放大器的设置设计.运算放大器的结构重要有三种:(a) 简单两级运放,(b)折叠共源共栅,(c)共源共栅,如图1 的前级所示。本次设计的运算放大器的设计指标要求差分输出幅度为±4V, 即输出端的所有NMOS 管的VDSAT,N 之和小于0.5V,输出端的所有PMOS 管的VDSAT,P 之和也必须小于0.5V。
运放结构的选择
手机信号放大器的设置设计.运算放大器的结构重要有三种:(a) 简单两级运放,(b)折叠共源共栅,(c)共源共栅,如图1 的前级所示。本次设计的运算放大器的设计指标要求差分输出幅度为±4V, 即输出端的所有NMOS 管的VDSAT,N 之和小于0.5V,输出端的所有PMOS 管的VDSAT,P 之和也必须小于0.5V。
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